- 目录 求助原题 我的方案 状态转移图 我的设计 等待你的方案？ 求助原题 先给出原题：（蓝色字体，即是链接本身） We want to add parity checking to the serial receiver. Parity checking adds one extra bit after each data byte. We will use... 目录 求助原题 我的方案 状态转移图 我的设计 等待你的方案？ 求助原题 先给出原题：（蓝色字体，即是链接本身） We want to add parity checking to the serial receiver. Parity checking adds one extra bit after each data byte. We will use...
- 这篇博客，通过举例说明：非阻塞赋值和阻塞赋值的区别？ 一般非阻塞赋值用于时序逻辑，而阻塞赋值用于组合逻辑； 非阻塞赋值语句是并行执行的，等到一个时钟完成后才完成赋值，而阻塞赋值是顺序执行的，下一条赋值语句要等到上一条赋值语句完成后才能赋值，并且阻塞赋值是立即完成的； 例如： always@(posedge clk) begin b <= a; c ... 这篇博客，通过举例说明：非阻塞赋值和阻塞赋值的区别？ 一般非阻塞赋值用于时序逻辑，而阻塞赋值用于组合逻辑； 非阻塞赋值语句是并行执行的，等到一个时钟完成后才完成赋值，而阻塞赋值是顺序执行的，下一条赋值语句要等到上一条赋值语句完成后才能赋值，并且阻塞赋值是立即完成的； 例如： always@(posedge clk) begin b <= a; c ...
- 文章目录 设计抽象层设计风格自顶向下自下而上 参考资料 设计抽象层 在了解Verilog语言的更多细节之前，我们最好先了解一下芯片设计中的不同抽象层。 最上层是系统级的架构，它定义了各种子块，并根据功能对它们进行分组，例如，一个处理器集群将有多个内核、缓存块和缓存一致性逻辑。所有这些都将被封装并表示为一个具有输入输出信号的单块。 如下图为顶层架构：... 文章目录 设计抽象层设计风格自顶向下自下而上 参考资料 设计抽象层 在了解Verilog语言的更多细节之前，我们最好先了解一下芯片设计中的不同抽象层。 最上层是系统级的架构，它定义了各种子块，并根据功能对它们进行分组，例如，一个处理器集群将有多个内核、缓存块和缓存一致性逻辑。所有这些都将被封装并表示为一个具有输入输出信号的单块。 如下图为顶层架构：...
- 文章目录 写在前面正文什么是半导体？半导体掺杂结论 原文附录What Is a Semiconductor?Semiconductor DopingConclusion 写在前面 2020年5月26晚记，昨天刚毕业答辩结束，即使通过了，由于后面还有很大概率继续抽取校盲，论文还是要添加以及修改。 在仿真的过程中，由于电脑性能太差，以及MATLAB仿... 文章目录 写在前面正文什么是半导体？半导体掺杂结论 原文附录What Is a Semiconductor?Semiconductor DopingConclusion 写在前面 2020年5月26晚记，昨天刚毕业答辩结束，即使通过了，由于后面还有很大概率继续抽取校盲，论文还是要添加以及修改。 在仿真的过程中，由于电脑性能太差，以及MATLAB仿...
- ROS2Foxy功能包不断完善，Gazebo新版Ignition Robotics功能也更加丰富！ 这里参考GSoC 2020 Ignition gazebo： （ROS2课程将更新为Foxy+Ignition） 旧版课程专栏：https://blog.csdn.net/zhangrelay/category_9327597.html 以下内容为机... ROS2Foxy功能包不断完善，Gazebo新版Ignition Robotics功能也更加丰富！ 这里参考GSoC 2020 Ignition gazebo： （ROS2课程将更新为Foxy+Ignition） 旧版课程专栏：https://blog.csdn.net/zhangrelay/category_9327597.html 以下内容为机...
- 目录 D Latch DFF + GATE Mux + DFF MUX2 + DFF FSM JK 触发器 Edgedetect（边沿检测） 双边沿检测 D Latch Implement the following circuit: 这是一个锁存器，高电平跟随，低电平保持，于是设计： module top_module ( in... 目录 D Latch DFF + GATE Mux + DFF MUX2 + DFF FSM JK 触发器 Edgedetect（边沿检测） 双边沿检测 D Latch Implement the following circuit: 这是一个锁存器，高电平跟随，低电平保持，于是设计： module top_module ( in...
- 文章目录 写在前面正文选择制造商关键参数数模转换器模数转换器时钟频率通用串行总线（USB）电容式触摸感成本和包装尺寸评估硬件 结论 延伸阅读交个朋友 写在前面 原文链接 相关博文 博客首页 注：知识搬运，供学习交流使用，侵联删！ 本文是微控制器简介系列的继续，讨论了当您试图为下一个项目寻找最佳MCU时要考虑的最重要事项。 正文 本文是微控制器... 文章目录 写在前面正文选择制造商关键参数数模转换器模数转换器时钟频率通用串行总线（USB）电容式触摸感成本和包装尺寸评估硬件 结论 延伸阅读交个朋友 写在前面 原文链接 相关博文 博客首页 注：知识搬运，供学习交流使用，侵联删！ 本文是微控制器简介系列的继续，讨论了当您试图为下一个项目寻找最佳MCU时要考虑的最重要事项。 正文 本文是微控制器...
- 文章目录 前言一道时序分析的例题解答一：能否正确工作分析解答二：最大时钟速率分析延伸二：最小时钟速率？解答三：保持时间不足情形分析 前言 本文来自于《FPGA 之道》，在正式讲解时序分析之前，作者给出了一道时序分析的例题，体会下人工分析时序的例子，挺有意思，一起看下。 时序分析在FPGA当中，算是有点烧脑的内容，通过都是通过画图的方式理解，比较通俗，... 文章目录 前言一道时序分析的例题解答一：能否正确工作分析解答二：最大时钟速率分析延伸二：最小时钟速率？解答三：保持时间不足情形分析 前言 本文来自于《FPGA 之道》，在正式讲解时序分析之前，作者给出了一道时序分析的例题，体会下人工分析时序的例子，挺有意思，一起看下。 时序分析在FPGA当中，算是有点烧脑的内容，通过都是通过画图的方式理解，比较通俗，...
- 文章目录 背景正文介绍Verilog有什么用途？如何验证Verilog设计的功能？Verilog设计模板 参考资料汇总 背景 集成电路的设计经历了从原理图绘制（工程师在纸上绘制晶体管及其连接，以便对其设计，使其可以在硅上制造）到硬件描述语言的转变，这是因为大型的设计，如果使用原理图的方式进行设计会耗费大量的人力、时间和资源等，这催生着硬件描述语言的诞... 文章目录 背景正文介绍Verilog有什么用途？如何验证Verilog设计的功能？Verilog设计模板 参考资料汇总 背景 集成电路的设计经历了从原理图绘制（工程师在纸上绘制晶体管及其连接，以便对其设计，使其可以在硅上制造）到硬件描述语言的转变，这是因为大型的设计，如果使用原理图的方式进行设计会耗费大量的人力、时间和资源等，这催生着硬件描述语言的诞...
- 参考链接： blog.csdn.net/ZhangRelay/article/details/42586491roboticsshop.net/best-robotics-simulation-software/ 目前最主流的机器人操作系统为ROS1+ROS2，已成业界共识，如果没有购买机器人硬件又想学习机器人相关知识，那么一款仿真软件必不可少，软件分为免费和付费，下面将... 参考链接： blog.csdn.net/ZhangRelay/article/details/42586491roboticsshop.net/best-robotics-simulation-software/ 目前最主流的机器人操作系统为ROS1+ROS2，已成业界共识，如果没有购买机器人硬件又想学习机器人相关知识，那么一款仿真软件必不可少，软件分为免费和付费，下面将...
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- 前言 对于使用FPGA进行项目开发的FPGA开发者来说，大多数是自己定制一整套系统，这样对于系统原理图的绘制必不可少。在涉及FPGA这一块，我们可以发现对于FPGA芯片的供电是一个有讲究的事情，下面内容摘自《FPGA之道》这本书，对于FPGA的供电系统进行学习。 FPGA芯片的供电 任何电路的工作都离不开电源的供给，FPGA芯片也一样。一般来说，FPGA芯片在正常... 前言 对于使用FPGA进行项目开发的FPGA开发者来说，大多数是自己定制一整套系统，这样对于系统原理图的绘制必不可少。在涉及FPGA这一块，我们可以发现对于FPGA芯片的供电是一个有讲究的事情，下面内容摘自《FPGA之道》这本书，对于FPGA的供电系统进行学习。 FPGA芯片的供电 任何电路的工作都离不开电源的供给，FPGA芯片也一样。一般来说，FPGA芯片在正常...
- 文章目录 前言双阈值标准TTLLVTTLLVTTL3V3LVTTL2V5 CMOSLVCOMSLVCOMS3V3LVCOMS2V5LVCOMS1V8LVCOMS1V5LVCOMS1V2 LVDSRS232RS485不同标准之间能否混连？ 前言 我们在对FPGA项目进行约束的时候，常常看到这样的电平标准，例如LVCOM18，LVCOS25，LVDS，L... 文章目录 前言双阈值标准TTLLVTTLLVTTL3V3LVTTL2V5 CMOSLVCOMSLVCOMS3V3LVCOMS2V5LVCOMS1V8LVCOMS1V5LVCOMS1V2 LVDSRS232RS485不同标准之间能否混连？ 前言 我们在对FPGA项目进行约束的时候，常常看到这样的电平标准，例如LVCOM18，LVCOS25，LVDS，L...
- 目录 背景 原题复现 审题 我的设计1 我的设计2 背景 曾经专门写过这个话题，可是今天在练习HDLBits时候，又发现了这个问题，但是以前的思路我已经忘了，不得不回顾。 FPGA中如何实现双边沿采样？ 奇怪的是我竟然之前用过的方法，今天我已经想不通为什么了？ 直接见原题吧： 原题复现 You're familiar with flip-flops... 目录 背景 原题复现 审题 我的设计1 我的设计2 背景 曾经专门写过这个话题，可是今天在练习HDLBits时候，又发现了这个问题，但是以前的思路我已经忘了，不得不回顾。 FPGA中如何实现双边沿采样？ 奇怪的是我竟然之前用过的方法，今天我已经想不通为什么了？ 直接见原题吧： 原题复现 You're familiar with flip-flops...
- 文章目录 前言开发板制作 前言 学习FPGA的初期，我们习惯到网上买一款FPGA开发板，这是新手学习FPGA开发的最佳途径，负责任的开发板制作者会提供相应的教程供练习，毕竟能动手操作上板子才是真正玩过FPGA，纸上谈兵始终是难以成长起来的。 但在高校或者研究所等场合更多的是跟着负责人或者导师自己制作FPGA开发板以适应项目需求。 上面提供的两种方式也... 文章目录 前言开发板制作 前言 学习FPGA的初期，我们习惯到网上买一款FPGA开发板，这是新手学习FPGA开发的最佳途径，负责任的开发板制作者会提供相应的教程供练习，毕竟能动手操作上板子才是真正玩过FPGA，纸上谈兵始终是难以成长起来的。 但在高校或者研究所等场合更多的是跟着负责人或者导师自己制作FPGA开发板以适应项目需求。 上面提供的两种方式也...
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