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- 1 问题 用Wireshake抓取HTTP请求包 2 解决办法 直接在在WireShare里面过滤条件输入http 然后在浏览器输入http的请求，我的效果如下 看吧，都是http请求 如果数据太多，我只需要过滤一个目的的ip,我们可以这样设置参数 ip.addr == 目的ip &... 1 问题 用Wireshake抓取HTTP请求包 2 解决办法 直接在在WireShare里面过滤条件输入http 然后在浏览器输入http的请求，我的效果如下 看吧，都是http请求 如果数据太多，我只需要过滤一个目的的ip,我们可以这样设置参数 ip.addr == 目的ip &...
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- 1 问题 我在windows电脑里面的终端通过ping 泛域名，可以看到这个域名解析的地址，后面做了这个泛域名解析地址做了修改，但是我ping 这个泛域名地址的时候依然是之前的地址，然后我把终端关闭掉，再次ping这个地址，发现解析的地址依然和上次一样，然后想到是DNS有缓存，我们刷新下DNS缓存 &nb... 1 问题 我在windows电脑里面的终端通过ping 泛域名，可以看到这个域名解析的地址，后面做了这个泛域名解析地址做了修改，但是我ping 这个泛域名地址的时候依然是之前的地址，然后我把终端关闭掉，再次ping这个地址，发现解析的地址依然和上次一样，然后想到是DNS有缓存，我们刷新下DNS缓存 &nb...
- 怎样理解Linux的文件系统 Linux 所有 文件 都从root开始，用'/'代表, 并且延伸到子目录。DOS/Windows有不同的分区同时目录都存于分区上。Linux则通过'加载'的方式把所有分区都放置在root下制定的目录里。windows下最接近于root的是c:。 一句话总结：Windows下，目录... 怎样理解Linux的文件系统 Linux 所有 文件 都从root开始，用'/'代表, 并且延伸到子目录。DOS/Windows有不同的分区同时目录都存于分区上。Linux则通过'加载'的方式把所有分区都放置在root下制定的目录里。windows下最接近于root的是c:。 一句话总结：Windows下，目录...
- 2021.0719测试ok 环境 windows10 64位 visual studio 2017 python 3.6 python-pcl 1.8.1 windows下安装python-pcl PCL（Point Cloud Library）是在吸收了前人点云相关研究基础上建立起来的大型跨平台开源C++编程库,python-pcl是封装了部分PCL的python接... 2021.0719测试ok 环境 windows10 64位 visual studio 2017 python 3.6 python-pcl 1.8.1 windows下安装python-pcl PCL（Point Cloud Library）是在吸收了前人点云相关研究基础上建立起来的大型跨平台开源C++编程库,python-pcl是封装了部分PCL的python接...
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- 博文目录 写在前面正文七段数码管原理七段数码管译码表单个七段数码管显示verilog设计多个数码管动态扫描显示 参考资料交个朋友 写在前面 作为FPGA的基础知识教程怎么能少得了这个简单的实际应用七段数码管显示，本篇博文算得上是对以往这个话题的一个总结吧！ 注：数码管本身是七段，但是加上小数点之后就是八段了！ 正文 七段数码管原理 七段... 博文目录 写在前面正文七段数码管原理七段数码管译码表单个七段数码管显示verilog设计多个数码管动态扫描显示 参考资料交个朋友 写在前面 作为FPGA的基础知识教程怎么能少得了这个简单的实际应用七段数码管显示，本篇博文算得上是对以往这个话题的一个总结吧！ 注：数码管本身是七段，但是加上小数点之后就是八段了！ 正文 七段数码管原理 七段...
- 目录 时钟管理器（CMT） DCM (1) 延时锁相环（DLL）。 (2) 数字频率综合器（DFS）。 (3) 相移单元（PS）。 (4) 状态逻辑。 DCM原语 PLL 组成 工作原理 PLL的原语 PLL作用 (1) PLL 对时钟网络去歪斜SKEW。 (2) PLL 用于频率合成。 (3) PLL用作抖动滤波器。 应用模型... 目录 时钟管理器（CMT） DCM (1) 延时锁相环（DLL）。 (2) 数字频率综合器（DFS）。 (3) 相移单元（PS）。 (4) 状态逻辑。 DCM原语 PLL 组成 工作原理 PLL的原语 PLL作用 (1) PLL 对时钟网络去歪斜SKEW。 (2) PLL 用于频率合成。 (3) PLL用作抖动滤波器。 应用模型...
- 背景： 这是一个让我感到耻辱而又欣慰的实验，大约花了我4个半小时时间才调通我下面要写的这篇博文的内容，这篇博文的内容比较简单，所以花这么久时间让我感到自己很弱，故而耻辱，而通过自己的各种改动，适合自己的一块没有资料的FPGA开发板，又是很欣慰的。 一个带小数点的数码管的所有8个发光二极管的正极或负极有一个公共端，通常必须接GND（共阴极数码管）或者接VCC（共阳极数码管... 背景： 这是一个让我感到耻辱而又欣慰的实验，大约花了我4个半小时时间才调通我下面要写的这篇博文的内容，这篇博文的内容比较简单，所以花这么久时间让我感到自己很弱，故而耻辱，而通过自己的各种改动，适合自己的一块没有资料的FPGA开发板，又是很欣慰的。 一个带小数点的数码管的所有8个发光二极管的正极或负极有一个公共端，通常必须接GND（共阴极数码管）或者接VCC（共阳极数码管...
- cmd 命令大全 一 cleanmgr–打开磁盘清理工具 compmgmt.msc－－－计算机管理 conf—-启动 netmeeting charmap–－启动字符映射表 calc—-启动计算器 chkdsk.exe–－Chkdsk磁盘检查 cmd.exe–－CMD命令提示符 certmgr.msc–证书管理实用程序 cliconfg–SQL SERVER 客户端... cmd 命令大全 一 cleanmgr–打开磁盘清理工具 compmgmt.msc－－－计算机管理 conf—-启动 netmeeting charmap–－启动字符映射表 calc—-启动计算器 chkdsk.exe–－Chkdsk磁盘检查 cmd.exe–－CMD命令提示符 certmgr.msc–证书管理实用程序 cliconfg–SQL SERVER 客户端...
- IP核介绍： IP（知识产权）核将一些在数字电路中常用但比较复杂的功能块，如FIR滤波器，SDRAM控制器，PCI接口等做成一个“黑盒”或者可修改参数的模块，供设计者使用。IP核包括硬IP与软IP。调用IP核能避免重复劳动，大大减轻设计人员的工作量。 IP Core生成器（Core Generator）是Xilinx FPGA设计中的一个重要设计工具，提供了大量成熟的、高效的... IP核介绍： IP（知识产权）核将一些在数字电路中常用但比较复杂的功能块，如FIR滤波器，SDRAM控制器，PCI接口等做成一个“黑盒”或者可修改参数的模块，供设计者使用。IP核包括硬IP与软IP。调用IP核能避免重复劳动，大大减轻设计人员的工作量。 IP Core生成器（Core Generator）是Xilinx FPGA设计中的一个重要设计工具，提供了大量成熟的、高效的...
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