- 学生实验报告 实验课名称：计算机组成原理 实验项目名称：基本运算器实验 一、实验名称： 基本运算器实验 二、实验目的： （1）了解运算器的组成原理 （2）掌握运算器的工作原理 三、实验要求： 通过一个基本运算器实验，了解运算器的组成原理、工作原理，了解运算器的基本结构，设计一个加法器。 四、实验内容： &... 学生实验报告 实验课名称：计算机组成原理 实验项目名称：基本运算器实验 一、实验名称： 基本运算器实验 二、实验目的： （1）了解运算器的组成原理 （2）掌握运算器的工作原理 三、实验要求： 通过一个基本运算器实验，了解运算器的组成原理、工作原理，了解运算器的基本结构，设计一个加法器。 四、实验内容： &...
- 学生实验报告 实验课名称：计算机组成原理 实验项目名称：系统总线与系统接口 一、实验名称： （1）系统总线和具有基本输入输出功能的总线接口实验 （2）具有中断控制功能的总线接口实验 （3）具有DMA控制功能的总线接口实验 二、实验目的： 1）系统总线和具有基本输入输出功能的总线接口实验 （1）理解总线的概念及其特性。 （2）掌握控制总线的功能和应用。 2）具有... 学生实验报告 实验课名称：计算机组成原理 实验项目名称：系统总线与系统接口 一、实验名称： （1）系统总线和具有基本输入输出功能的总线接口实验 （2）具有中断控制功能的总线接口实验 （3）具有DMA控制功能的总线接口实验 二、实验目的： 1）系统总线和具有基本输入输出功能的总线接口实验 （1）理解总线的概念及其特性。 （2）掌握控制总线的功能和应用。 2）具有...
- Nginx配置相关结构划分的技巧 原文来自：http://developer.51cto.com/art/201003/190953.htm Nginx配置需要一定的技巧，我们在不断的使用和维护中就会发现这些，接下来就向大家介绍下有关Nginx配置的相关技巧。我目前的Nginx配置是拆散的，这样可以便于在很多个虚拟主机和目录里重用部分配置。 总体是划分为这样一个结构：... Nginx配置相关结构划分的技巧 原文来自：http://developer.51cto.com/art/201003/190953.htm Nginx配置需要一定的技巧，我们在不断的使用和维护中就会发现这些，接下来就向大家介绍下有关Nginx配置的相关技巧。我目前的Nginx配置是拆散的，这样可以便于在很多个虚拟主机和目录里重用部分配置。 总体是划分为这样一个结构：...
- 1、bx、si、di和bp Bx、si和di这3个寄存器我们已经学过了，现在进行一下总结，并学一下bp。 1：在8086CPU中，只有这4个寄存器可以用在[…]中来进行内存单元的寻址。比如，下面的指令都是正确 的： Mov ax, [bx] Mov ax, [bx＋si] Mov ax, [bx＋di] Mov ax, [bp] Mov ax, [bp＋... 1、bx、si、di和bp Bx、si和di这3个寄存器我们已经学过了，现在进行一下总结，并学一下bp。 1：在8086CPU中，只有这4个寄存器可以用在[…]中来进行内存单元的寻址。比如，下面的指令都是正确 的： Mov ax, [bx] Mov ax, [bx＋si] Mov ax, [bx＋di] Mov ax, [bp] Mov ax, [bp＋...
- 1、内存中字的存储 2、ds和【address】 CPU要读写一个内存单元的时候，必须先给出这个内存单元的地址，在8086CPU中，内存地址由段地址和偏移地址组成， 其中，段地址存放在段寄存器DS中，DS称作数据段寄存器。 如果我们要将内存地址为14A70的内存单元中的数据送入AL中，可以用如下的程序段进行： Mov bx，1000H &n... 1、内存中字的存储 2、ds和【address】 CPU要读写一个内存单元的时候，必须先给出这个内存单元的地址，在8086CPU中，内存地址由段地址和偏移地址组成， 其中，段地址存放在段寄存器DS中，DS称作数据段寄存器。 如果我们要将内存地址为14A70的内存单元中的数据送入AL中，可以用如下的程序段进行： Mov bx，1000H &n...
- 1、寄存器 32位寄存器有16个，分别是： 4个数据寄存器（EAX、EBX、ECX、EDX）。 2个变址和指针寄存器（ESI和EDI）；2个指针寄存器（ESP和EBP）。 6个段寄存器（ES、CS、SS、DS、FS、GS）。 1个指令指针寄存器（EIP）；1个标志寄存器（EFlags）。 2、数据寄存器 数据寄存器主要用来保存操作数和运算结果等信息，从... 1、寄存器 32位寄存器有16个，分别是： 4个数据寄存器（EAX、EBX、ECX、EDX）。 2个变址和指针寄存器（ESI和EDI）；2个指针寄存器（ESP和EBP）。 6个段寄存器（ES、CS、SS、DS、FS、GS）。 1个指令指针寄存器（EIP）；1个标志寄存器（EFlags）。 2、数据寄存器 数据寄存器主要用来保存操作数和运算结果等信息，从...
- linux的touch命令不常用，一般在使用make的时候可能会用到，用来修改文件时间戳，或者新建一个不存在的文件。 1．命令格式： touch [选项]... 文件... 2．命令参数： -a 或--time=atime或--time=access或--time=use 只更改存取时间。 ... linux的touch命令不常用，一般在使用make的时候可能会用到，用来修改文件时间戳，或者新建一个不存在的文件。 1．命令格式： touch [选项]... 文件... 2．命令参数： -a 或--time=atime或--time=access或--time=use 只更改存取时间。 ...
- 时钟资源 时钟布线资源具有高速、低SKEW的特点，它对系统设计非常重要，即使系统速率不高，也应该关注时钟设计，以消除潜在的时钟危险。Spartan-6器件包含16个全局时钟资源和40个I/O区域时钟资源。全局时钟用于系统时钟，而I/O区域时钟专用于I/O串行/解串（ISERDES和OSERDES）设计。 Spartan-6时钟资源包含以下4种。全局时钟输入引脚（GCLK）。局... 时钟资源 时钟布线资源具有高速、低SKEW的特点，它对系统设计非常重要，即使系统速率不高，也应该关注时钟设计，以消除潜在的时钟危险。Spartan-6器件包含16个全局时钟资源和40个I/O区域时钟资源。全局时钟用于系统时钟，而I/O区域时钟专用于I/O串行/解串（ISERDES和OSERDES）设计。 Spartan-6时钟资源包含以下4种。全局时钟输入引脚（GCLK）。局...
- ILA属性 双击【Xilinx Core Generator】，打开现有的IP核工程项目或者创建一个新的IP核工程。【View by function】→【Debug & Verification】→【ChipScope Pro】，双击ILA。弹出ILA触发和配置界面，如图9-7所示。(1) 【Component Name】：输入组件名称。 (2) Trigger P... ILA属性 双击【Xilinx Core Generator】，打开现有的IP核工程项目或者创建一个新的IP核工程。【View by function】→【Debug & Verification】→【ChipScope Pro】，双击ILA。弹出ILA触发和配置界面，如图9-7所示。(1) 【Component Name】：输入组件名称。 (2) Trigger P...
- 可配置逻辑模块（CLB）Spartan-6每个CLB模块里包含两个SLICE。CLB通过交换矩阵和外部通用逻辑阵列相连，如图2-1和图2-2所示。底部的SLICE标号为SLICE0，顶部的SLICE标号为SLICE1。两个SLICE没有直接连接。 每个SLICE包含4个LUT和8个存储单元。这些基本单元能提供逻辑和ROM功能。有些SLICE，称为SLIC... 可配置逻辑模块（CLB）Spartan-6每个CLB模块里包含两个SLICE。CLB通过交换矩阵和外部通用逻辑阵列相连，如图2-1和图2-2所示。底部的SLICE标号为SLICE0，顶部的SLICE标号为SLICE1。两个SLICE没有直接连接。 每个SLICE包含4个LUT和8个存储单元。这些基本单元能提供逻辑和ROM功能。有些SLICE，称为SLIC...
- 问题叙述： 当拨码开关SW3处于OFF时， LED停止不动，只有一个LED处于点亮，并且点亮的LED不会变化；而SW3处于ON状态时，流水灯处于流动状态。导航按键S2被按下后，LED流动方向是从上到下（D9到D2方向）；导航按键S3被按下后，LED流动方向是从下到上（D2到D9）。 这里面用到了拨码开关，按键，以及led灯，那么我把这三种外设的电路图给出来，并简... 问题叙述： 当拨码开关SW3处于OFF时， LED停止不动，只有一个LED处于点亮，并且点亮的LED不会变化；而SW3处于ON状态时，流水灯处于流动状态。导航按键S2被按下后，LED流动方向是从上到下（D9到D2方向）；导航按键S3被按下后，LED流动方向是从下到上（D2到D9）。 这里面用到了拨码开关，按键，以及led灯，那么我把这三种外设的电路图给出来，并简...
- 博文目录 写在前面正文七段数码管原理七段数码管译码表单个七段数码管显示verilog设计多个数码管动态扫描显示 参考资料交个朋友 写在前面 作为FPGA的基础知识教程怎么能少得了这个简单的实际应用七段数码管显示，本篇博文算得上是对以往这个话题的一个总结吧！ 注：数码管本身是七段，但是加上小数点之后就是八段了！ 正文 七段数码管原理 七段... 博文目录 写在前面正文七段数码管原理七段数码管译码表单个七段数码管显示verilog设计多个数码管动态扫描显示 参考资料交个朋友 写在前面 作为FPGA的基础知识教程怎么能少得了这个简单的实际应用七段数码管显示，本篇博文算得上是对以往这个话题的一个总结吧！ 注：数码管本身是七段，但是加上小数点之后就是八段了！ 正文 七段数码管原理 七段...
- PicoBlaze 8 位微控制器 PicoBlaze 是一个8 位的微控制器，非常适合于Spartan 系列及Virtex 系列FPGA。还可以用于CPLD，但是需要外部加SRAM 存储器以运行程序。它又被称为常数化的可编程状态机KCPSM（(K)constant Coded Programmable State Machine），之所以这样称呼它，是因为PicoBlaze... PicoBlaze 8 位微控制器 PicoBlaze 是一个8 位的微控制器，非常适合于Spartan 系列及Virtex 系列FPGA。还可以用于CPLD，但是需要外部加SRAM 存储器以运行程序。它又被称为常数化的可编程状态机KCPSM（(K)constant Coded Programmable State Machine），之所以这样称呼它，是因为PicoBlaze...
- SelectIO资源 Spartan-6有丰富的I/O资源，包括SelectIO和RocketIO。 Spartan-6每个I/O片（Tile）包含两个IOB、两个ILOGIC2、两个OLOGIC2和两个IODELAY2，见图2-37。 在这一小节里，分以下几个方面介绍Spartan-6的SelectIO资源。SelectIO的电气特性。SelectIO的逻辑资源... SelectIO资源 Spartan-6有丰富的I/O资源，包括SelectIO和RocketIO。 Spartan-6每个I/O片（Tile）包含两个IOB、两个ILOGIC2、两个OLOGIC2和两个IODELAY2，见图2-37。 在这一小节里，分以下几个方面介绍Spartan-6的SelectIO资源。SelectIO的电气特性。SelectIO的逻辑资源...
- 有了上两篇博文的铺垫，双通道模式以及四通道模式，单通道模式也就很容易理解了，并且我已经想好了下一篇博文要写什么了。 直接看框架图吧： 直接说重点，任意一个输入端口输入的模拟信号同时进入ADC芯片的四个核（也可以理解为4个通道），这四个核的时钟输入是由内部时钟电路（Clock Circuit）产生的，这四个时钟之间是什么关系呢？ 首先这四个时钟频率一致，都是1.25GHz。 ... 有了上两篇博文的铺垫，双通道模式以及四通道模式，单通道模式也就很容易理解了，并且我已经想好了下一篇博文要写什么了。 直接看框架图吧： 直接说重点，任意一个输入端口输入的模拟信号同时进入ADC芯片的四个核（也可以理解为4个通道），这四个核的时钟输入是由内部时钟电路（Clock Circuit）产生的，这四个时钟之间是什么关系呢？ 首先这四个时钟频率一致，都是1.25GHz。 ...
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